第三章 集成门电路与触发器第 三 章集 成 门 电 路 与 触 发 器第三章 集成门电路与触发器集成门电路和触发器等逻辑器件是实现数字系统功能的物质基础 。
随着微电子技术的发展,人们把实现各种逻辑功能的元器件及其连线都集中制造在同一块半导体材料小片上,并封装在一个壳体中,通过引线与外界联系,即构成所谓的 集成电路块,通常又称为 集成电路芯片 。
采用集成电路进行数字系统设计的 优点：
可靠性高,可维性好,功耗低,成本低等优点,可以大大简化设计和调试过程 。
第三章 集成门电路与触发器本章知识要点,
● 半导体器件的开关特性；
● 逻辑门电路的功能、外部特性及使用方法；
● 常用触发器的功能、触发方式与外部工作特性。
第三章 集成门电路与触发器
3.1 数字集成电路的分 类数字集成电路通常按照所用半导体器件的不同或者根据集成规模的大小进行分类 。
一、根据所采用的半导体器件进行分类根据所采用的半导体器件，数字集成电路可以分为 两大类。
1.双极型集成电路,采用双极型半导体器件作为元件。主要特点是 速度快、负载能力强，但功耗较大,集成度较低。
2.单极型集成电路 (又称为 MOS集成电路 ):采用金属 -氧化物半导体场效应管 (Metel Oxide Semiconductor Field Effect
Transister)作为元件。主要特点是 结构简单、制造方便、集成度高、功耗低，但速度较慢。
第三章 集成门电路与触发器双极型集成电路又可进一步可分为：
TTL(Transistor Transistor Logic)电路；
ECL(Emitter Coupled Logic)电路；
I2L(Integrated Injection Logic)电路。
┊
TTL电路的“性能价格比”最佳，应用最广泛。
MOS集成电路又可进一步分为：
PMOS( P-channel Metel Oxide Semiconductor)；
NMOS(N-channel Metel Oxide Semiconductor)；
CMOS(Complement Metal Oxide Semiconductor)。
┊
CMOS电路应用较普遍,因为它不但适用于通用逻电路的设计,而且综合性能最好 。
第三章 集成门电路与触发器二、根据集成电路规模的大小进行分类通常根据一片集成电路芯片上包含的逻辑门个数或元件个数,分为 SSI,MSI,LSI,VLSI。
1,SSI (Small Scale Integration ) 小规模集成电路,
逻辑门数小于 10 门 (或元件数小于 100个 )；
2,MSI (Medium Scale Integration ) 中规模集成电路,
逻辑门数为 10 门～ 99 门 (或元件数 100个～ 999个 )；
3,LSI (Large Scale Integration ) 大规模集成电路,
逻辑门数为 100 门～ 9999 门 (或元件数 1000个～ 99999个 )；
4,VLSI (Very Large Scale Integration) 超大规模集成电路,
逻辑门数大于 10000 门 (或元件数大于 100000个 )。
第三章 集成门电路与触发器
3,2 半导体器件的开关特性数字电路中的晶体二极管,三极管和 MOS管等器件一般是以开关方式运用的,其工作状态相当于相当于开关的,接通,
与,断开,。
数子系统中的半导体器件运用在开关频率十分高的电路中
(通常开关状态变化的速度可高达每秒百万次数量级甚至千万次数量级 ),研究这些器件的开关特性时,不仅要研究它们的 静止特性,而且还要分析它们的 动态特性 。
静态特性是指二极管在导通和截止两种稳定状态下的特性。
3.2.1 晶体二极管的开关特性一、静态特性第三章 集成门电路与触发器典型二极管的静态特性曲线
(又称伏安特性曲线 ),
1,正向特性门槛电压 ( VTH ),使二极管开始导通的正向电压,又称为阈值电压 (一般锗管约 0.1V,硅管约 0.5V)。
★ 正向电压 VD ≤ VTH,管子截止，电阻很大、正向电流 IF 接近于 0,二极管类似于开关的断开状态 ；
★ 正向电压 VD = VTH,管子开始导通，正向电流 IF 开始上升；
★ 正向电压 VD ＞ VTH (一般锗管为 0.3V，硅管为 0.7V),管子充分导通,电阻很小，正向电流 IF 急剧增加，二极管类似于开关的接通状态。使二极管充分导通的电压为导通电压，用 VF表示。
第三章 集成门电路与触发器
2,反向特性二极管在反向电压 VR 作用下，处于截止状态，反向电阻很大，反向电流 IR 很小（将其称为反向饱和电流，用 IS 表示，通常可忽略不计 ）,二极管的状态类似于开关断开。 而且反向电压在一定范围内变化基本不引起反向电流的变化。
注意事项：
● 正向导通时可能因电流过大而导致二极管烧坏 。 组成实际电路时通常要串接一只电阻 R,以限制二极管的正向电流；
● 反向电压超过某个极限值时,将使反向电流 IR突然猛增,致使二极管被击穿 （ 通常将该反向电压极限值称为 反向击穿电压 VBR）,一般不允许反向电压超过此值 。
第三章 集成门电路与触发器二极管组成的开关电路图如图（ a）所示。二极管导通状态下的等效电路如图 (b)所示，截止状态下的等效电路如图
(c)所示，图中忽略了二极管的正向压降。
二极管开关电路及其等效电路
D
U
0 R R
断开
R
关闭
(a) (b) (c)
由于二极管的单向导电性，所以在数字电路中经常把它当作开关使用。
第三章 集成门电路与触发器二,动态特性二极管的动态特性是指二极管在导通与截止两种状态转换过程中的特性，它表现在完成两种状态之间的转换需要一定的时间。为此，引入了反向恢复时间和开通时间的概念。
1,反向恢复时间反向恢复时间,二极管从正向导通到反向截止所需要的时间称为反向恢复时间。
反向恢复时间 tre=存储时间 ts+渡越时间 tt
第三章 集成门电路与触发器
2,开通时间开通时间,二极管从反向截止到正向导通的时间称为开通时间 。
二极管的开通时间很短，对开关速度影响很小，相对反向恢复时间而言几乎可以忽略不计。
第三章 集成门电路与触发器
3.2.2 晶体三极管的开关特性晶体三极管由集电结和发射结两个 PN结构成 。 根据两个 PN结的偏置极性,三极管有 截止,放大,饱和 3种工作状态 。
一、静态特性第三章 集成门电路与触发器晶体三极管在截止与饱和这两种稳态下的特性称为三极管的静态开关特性 。
在数字逻辑电路中,三极管相当于一个由基极信号控制的无触点开关,其作用对应于触点开关的,闭合,与,断开,。
电路在三极管 截止 与 饱和 状态下的等效电路如下,
第三章 集成门电路与触发器晶体三极管在饱和与截止两种状态转换过程中具有的特性称为三极管的动态特性 。
三极管的开关过程和二极管一样,管子内部也存在着电荷的建立与消失过程 。 因此,两种状态的转换也需要一定的时间才能完成 。
二、动态特性第三章 集成门电路与触发器
1,开通时间 （ ton ）
开通时间,三极管从截止状态到饱和状态所需要的时间。
时间 ton =延迟时间 td +上升时间 tr
2,关闭时间 （ toff ）
关闭时间,三极管从饱和状态到截止状态所需要的时间 。
关闭时间 toff =存储时间 ts +下降时间 tf
开通时间 ton和关闭时间 toff是影响电路工作速度的主要因素。
第三章 集成门电路与触发器
3.2.3 MOS管的开关特性一、静态特性
MOS管作为开关元件，同样是工作在截止或导通两种状态。 MOS管是电压控制元件，主要由栅源电压 vGS决定其工作状态。
当 VGS＜开启电压 VTN时,MOS管工作在截止区,输出电压 vDS ≈VDD,MOS管处于,断开,状态 ;
当 VDS≥VGS－ VTN时,MOS管工作在导通区,输出电压
vDS≈ 0V,MOS管处于,接通,状态 。
第三章 集成门电路与触发器二、动态特性
MOS管本身导通和截止时电荷积累和消散的时间很小。
动态特性主要取决于电路中杂散电容充、放电所需的时间。
第三章 集成门电路与触发器为了提高 MOS器件的工作速度,引入了 CMOS电路 。
在 CMOS电路中,由于充电电路和放电电路都是低阻电路,因此,其充,放电过程都比较快,从而使 CMOS电路有较高的开关速度 。
第三章 集成门电路与触发器
3.3 逻 辑 门 电 路实现基本逻辑运算和常用复合逻辑运算的逻辑器件统称为逻辑门电路,它们是组成数字系统的基本单元电路 。
学习时应重点掌握集成逻辑门电路的功能和外部特性,
以及器件的使用方法 。 对其内部结构和工作原理只要求作一般了解 。
第三章 集成门电路与触发器
3.3.1 TTL 集成逻辑门电路
TTL(Transistor Transistor Logic)电路是晶体管 -晶体管逻辑电路的简称。
TTL电路的功耗大、线路较复杂，使其集成度受到一定的限制，故广泛应用于中小规模逻辑电路中。
下面，对几种常见 TTL门电路进行介绍，重点讨论 TTL
与非门。
第三章 集成门电路与触发器一、典型 TTL与非门该电路可按 图中虚线划分为 三部分：
输入级 —— 由多发射极晶体管 T1和电阻 R1组成；
中间级 —— 由晶体管 T2和电阻 R2,R3组成；
输出级 —— 由晶体管 T3,T4,D4和电阻 R4,R5组成。
1,电路结构及工作原理
(1) 电路结构典型 TTL与非门电路图及相应逻辑符号如右图所示。
第三章 集成门电路与触发器
(2) 工作原理
※ 输入端全部接高电平 (3.6V),电源 Vcc通过 R1和 T1的集电结向 T2提供足够的基极电流,使 T2饱和导通 。 T2的发射极电流在 R3上产生的压降又使 T4 饱和导通,输出为低电平 (≈ 0.3V)。
实现了,输入全高,输出为低,的逻辑关系 。
※ 当有输入端接低电平 (0.3V)时,输入端接低电平的发射结导通，使 T1的基极电位 Vb1=0.3V+0.7V=1V。该电压作用于 T1的集电结和 T2、
T4的发射结上，不可能使 T2和 T4导通。 由于 T2截止，电源 VCC通过 R2驱动
T3和 D4管，使之工作在导通状态，电路输出为高电平 (≈3.6V)。
实现了,输入有低，输出为高” 的逻辑功能。
第三章 集成门电路与触发器归纳,当输入 A,B,C均为高电平时,输出为低电平
(≈ 0V)；当 A,B,C中至少有一个为低电平时,输出为高电平 (≈ 3.6V)。 输出与输入之间为,与非,逻辑,即
A B CF?
第三章 集成门电路与触发器
2,主要外部特性参数
TTL与非门的主要外部特性参数有输出逻辑电平,开门电平,关门电平,扇入系数,扇出系数,平均传输时延和空载功耗等 。
(2) 输出低电平 VOL,输出低电平 VoL是指输入全为高电平时的输出电平 。 VOL的典型值是 0.3V。
(1) 输出高电平 VOH,指至少有一个输入端接低电平时的输出电平 。 VOH的典型值是 3.6V。
(3) 开门电平 VO N,指在额定负载下，使输出电平达到标准低电平
VSL的输入电平，它表示使与非门开通的最小输入电平。 VON的产品规范值为 VON≤1.8V 。
第三章 集成门电路与触发器
(4) 关门电平 VOFF,指输出空载时,使输出电平达到标准高电平 VSH的输入电平,它表示使与非门关断所允许的最大输入电平 。 VOFF 的产品规范值 VOFF≥ 0.8V。
(5) 扇入系数 Ni,指与非门允许的输入端数目。
(6) 扇出系数 No,指与非门输出端连接同类门的最多个数。
(7) 输入短路电流 IiS,指当与非门的某一个输入端接地而其余输入端 悬空时,流过接地输入端的电流 。
(8) 高电平输入电流 IiH,指某一输入端接高电平,而其他输入端接地时,流入高电平输入端的电流,又称为输入漏电流 。
第三章 集成门电路与触发器
(9) 平均传输延迟时间 tpd,指一个矩形波信号从与非门输入端传到与非门输出端 (反相输出 )所延迟的时间。通常将从输入波上沿中点到输出波下沿中点的时间延迟称为导通延迟时间 tpdL；从输入波下沿中点到输出波上沿中点的时间延迟称为截止延迟时间 tpdH。
平均延迟时间为,tpd = ( tpdL+ tpdH )/2
(10) 空载功耗 P,指与非门空载时电源总电流 ICC和电源电压 VCC的乘积 。
输出为低电平时的功耗称为空载导通功耗 PON,输出为高电平时的功耗称为空载截止功耗 POFF 。
平均功耗为,P =(PON + POFF)/2
第三章 集成门电路与触发器
3,TTL与非门集成电路芯片
TTL与非门集成电路芯片种类很多,常用的 TTL与非门集成电路芯片有 7400和 7420等 。
7400的引脚分配图如图 (a)所示； 7420的引脚分配图如图 (b)所示 。
第三章 集成门电路与触发器二、其他功能的 TTL门电路集成 TTL门电路还有 与门、或门、非门、或非门、与或非门、异或门 等不同功能的产品。此外，还有两种特殊门电路 —— 集电极开路门 (OC
门 )和三 态门 (TS门 )。
(1) 非门
1,几种常用的 TTL门电路第三章 集成门电路与触发器
(2) 或非门常用的 TTL或非门集成电路芯片有 2输入 4或非门 7402等。
7402的引脚分配图如下图所示。
第三章 集成门电路与触发器
(3) 与或非门常用的 TTL与或非门集成电路芯片 7451的引脚排列图如下图所示。
第三章 集成门电路与触发器
2,两种特殊的门电路
(1) 集电极开路门 (OC门 )
集电极开路门 (Open Collector Gate）是一种输出端可以直接相互连接的特殊逻辑门，简称 OC门。
图给出了一个集电极开路与非门的电路结构图和逻辑符号。
第三章 集成门电路与触发器注意 ！ 集电极开路与非门只有在外接负载电阻 RL和电源 U’CC后才能正常工作 。
集电极开路与非门在计算机中应用很广泛,可以用它实现 "线与 "逻辑,电平转换以及直接驱动发光二极管,干簧继电器等 。
第三章 集成门电路与触发器
(2) 三态输出门 (TS门 )
三态输出门有三种输出状态,输出高电平、输出低电平和高阻状态，前两种状态为工作状态，后一种状态为禁止状态 。 简称三态门 (Three state Gate),TS门等。
注意 ! 三态门不是指具有三种逻辑值。
如何使电路处在工作状态和禁止状态？
通过外加控制信号！
第三章 集成门电路与触发器例如：
该电路逻辑功能如下：
EN=0,二极管 D反偏,此时电路功能与一般与非门无区别,输出 ；
EN=1,一方面因为 T1有一个输入端为低,使 T2,T5截止 。 另一方面由于二极管导通,迫使 T3的基极电位变低,致使 T3,T4也截止 。 输出 F便被悬空,即处于高阻状态 。
第三章 集成门电路与触发器三态门常用于总线传输控制 。 如下图所示,用两种不同控制输入的三态门可构成的双向总线 。
图中：
EN=1时,G1工作,G2处于高阻状态,数据 D1被取反后送至总线；
EN=0时,G2工作,G1处于高阻状态,总线上的数据被取反后送到数据端 D2。
实现了数据的分时双向传送 。
第三章 集成门电路与触发器
3.3.2 CMOS集成逻辑门电路
MOS型集成门电路的主要 优点：制造工艺简单、集成度高、功耗小、抗干扰能力强等；主要缺点：速度相对 TTL电路较低 。
MOS门电路有三种类型：
使用 P沟道管的 PMOS电路；
使用 N沟道管的 NMOS电路；
同时使用 PMOS管和 NMOS管的 CMOS电路 。
相比之下,CMOS电路性能更优,是当前应用较普遍的逻辑电路之一 。 下面,仅讨论 CMOS集成逻辑门 。
第三章 集成门电路与触发器一,CMOS反相器由一个 N沟道增强型 MOS管 TN和一个 P沟道增强型 MOS管 TP组成的 CMOS
反相器如下图所示。
电路正常工作条件,VDD大于 TN管开启电压 VTN和 TP管开启电压 VTP的绝对值之和，即 VDD＞ VTN +|VTP|。
工作原理,vi=0V,TN截止,TP导通,vO≈VDD为高电平； vi = VDD,TN导通,TP截止,vO≈0V。实现了 "非 " 的逻辑功能。
第三章 集成门电路与触发器二,CMOS与非门由两个串联的 NMOS管和两个并联的 PMOS管构成的两输入端的 CMOS与非门电路如下图所示。
工作原理：
当输入 A,B均为高电平时,TN1和
TN2导通,TP1和 TP2截止,输出端 F为低电平；
当输入 A,B中至少有一个为低电平时,对应的 TN1 和 TN2中至少有一个截止,
TP1和 TP2中至少有一个导通,输出 F为高电平 。
该电路实现了,与非,逻辑功能 。
第三章 集成门电路与触发器三,CMOS或非门由两个并联的 NMOS管和两个串联的 PMOS管构成一个两个输入端的 CMOS或非门电路如下图所示 。 每个输入端连接到一个 NMOS管和一个 PMOS管的栅极 。
工作原理：
当输入 A,B均为低电平时,TN1和
TN2截止,TP1和 TP2导通,输出 F为高电平；
当输入端 A,B 中至少有一个为高电平时,则对应的 TN1,TN2中便至少有一个导通,TP1,TP2中便至少有一个截止,使输出 F为低电平 。
该电路实现了,或非,逻辑功能 。
第三章 集成门电路与触发器四,CMOS三态门
EN=1,T’N和 T’P同时截止,输出 F
呈高阻状态；
EN =0,T’N和 T’P同时导通,非门正常工作,实现 的功能 。
第三章 集成门电路与触发器
3.3.3 正逻辑和负逻辑前面讨论各种逻辑门电路的逻辑功能时,约定用高电平表示逻辑 1,低电平表示逻辑 0。 事实上,既可以规定用高电平表示逻辑 1,低电平表示逻辑 0,也可以规定用高电平表示逻辑 0,低电平表示逻辑 1。 这就引出了正逻辑和负逻辑的概念 。
正逻辑,用高电平表示逻辑 1,低电平表示逻辑 0。
负逻辑,用高电平表示逻辑 0,低电平表示逻辑 1。
第三章 集成门电路与触发器前面讨论各种逻辑门电路时，都是按照正逻辑规定来定义其逻辑功能的。
在本课程中,若无特殊说明,约定按正逻辑讨论问题,所有门电路的符号均按正逻辑表示 。
第三章 集成门电路与触发器
3.4 触 发 器在数字系统中,为了构造实现各种功能的逻辑电路,除了需要实现逻辑运算的逻辑门之外,还需要有能够保存信息的逻辑器件 。 触发器是一种具有记忆功能的电子器件 。
触发器能用来存储一位二进制信息。集成触发器的种类很多，分类方法也各不相同，但就其结构而言,都是由逻辑门加上适当的反馈线耦合而成。
第三章 集成门电路与触发器触发器的特点：
☆ 有两个互补的输出端 Q 和
☆ 在一定输入信号作用下，触发器可以从一个稳定状态转移到另一个稳定状态。
☆ 有两个稳定状态 。 通常将 Q = 1和 = 0 称为,1”状态,而把 Q = 0和 = 1称为,0” 状态 。 当输入信号不发生变化时,触发器状态稳定不变 。
第三章 集成门电路与触发器现态,输入信号作用前的状态，记作 Qn 和,一般简记为 Q和 ；
次态,输入信号作用后的状态，记作 Qn+1和 。
显然，次态是现态和输入的函数。
现态与次态的概念：
第三章 集成门电路与触发器
3.4.1 基本 R-S触发器基本 R-S触发器是直接复位置位触发器的简称，由于它是构成各种功能触发器的基本部件，故称为基本 R-S触发器。
一,用与非门构成的基本 R-S触发器
1.组成,由两个与非门交叉耦合构成,其逻辑图和逻辑符号分别如下图 (a)和 (b)所示 。 图中,R称为置 0端或者复位端，
S称为置 1端或置位端； 逻辑符号输入端加的小圆圈表示低电平或负脉冲有效。
第三章 集成门电路与触发器
2,工作原理
(1) 若 R=1,S=1，则触发器保持原来状态不变；
(2) 若 R=1,S=0,则触发器置为 1状态；
(3) 若 R=0,S=1,则触发器置为 0状态；
(4) 不允许出现 R=0,S=0。
第三章 集成门电路与触发器表中 "d"表示触发器次态不确定。该表又称为 次态真值表 。
RS Qn+1 功能说明
0 0
0 1
1 0
1 1
d
0
1
Q
不定置 0
置 1
不变基本 R-S触发器功能表
3,逻辑功能及其描述由与非门构成的 R-S触发器的逻辑功能如下表所示 。
第三章 集成门电路与触发器因为 R,S不允许同时为 0，所以输入必须满足 约束条件：
R + S = 1 (约束方程 )
若把触发器次态 Qn+1表示成现态 Q和输入 R,S的函数,则卡诺图如下：
用卡诺图化简后，可得到该触发器的 次态方程,
RQSQ n 1
第三章 集成门电路与触发器二、用或非门构成的基本 R-S触发器
1.组成,由两个或非门交叉耦合组成,其逻辑图和逻辑符号分别如图 (a)和图 (b)所示 。
该电路的输入是正脉冲或高电平有效,故逻辑符号的输入端未加小圆圈 。
第三章 集成门电路与触发器
2,逻辑功能下表给出了由或非门构成的 R-S触发器的逻辑功能。
RS Qn+1 功能说明
0 0
0 1
1 0
1 1
Q
1
0
d
不变置 1
置 0
不定基本 R-S触发器功能表基本 R-S触发器的 优点是结构简单 。 它不仅可作为记忆元件独立使用,而且由于它具有直接复位,置位功能,因而被作为各种性能完善的触发器的基本组成部分 。 但由于 R,S之间的约束关系,以及不能进行定时控制,使它的使用受到一定限制 。
次态方程和约束方程如下：
(次态方程 )
R · S = 0 (约束方程 )
第三章 集成门电路与触发器
3.4.2 几种常用的时钟控制触发器具有时钟脉冲控制的触发器称为,时钟控制触发器,或者
,定时触发器,。
时钟脉冲控制触发器的工作特点：
由时钟脉冲确定状态转换的时刻 (即何时转换？ ) ；
由输入信号确定触发器状态转换的方向 (即如何转换？ )。
下面介绍四种最常用的时钟控制触发器 。
第三章 集成门电路与触发器一,时钟控制 R-S触发器时钟控制 R-S触发器的逻辑图和逻辑符号如图 (a)、（ b）所示。
1,组成：
由四个与非门构成 。 其中,与非门 G1,G2构成基本 R-S
触发器；与非门 G3,G4组成控制电路,通常称为控制门 。
第三章 集成门电路与触发器
2,工作原理具体如下：
R=0,S=0,控制门 G3,G4的输出均为 1，
触发器状态保持不变；
R=0,S=1,控制门 G3,G4的输出分别为 1和 0,触发器状态置成 1状态；
R=1,S=0,控制门 G3,G4的输出分别为
0和 1,触发器状态置成 0状态；
R=1,S=1,控制门 G3,G4的输出均为 0，
触发器状态不确定,这是不允许的 。
● 当时钟脉冲没有到来（即 C=0）时，不管 R,S端为何值，
两个控制门的输出均为 1，触发器状态保持不变。
● 当时钟脉冲到来 （ 即 C=1） 时,输入端 R,S的值 可以通过控制门作用于上面的基本 R-S触发器 。
第三章 集成门电路与触发器注意 ！ 时钟控制 R-S触发器虽然解决了对触发器工作进行定时控制的问题,而且具有结构简单等优点,但依然存在如下两点不足：
● 输入信号依然存在约束条件,即 R,S不能同时为 1；
由分析可知,时钟控制 R-S触发器的工作过程是由时钟信号 C和输入信号 R,S共同作用的；时钟 C控制转换时间,
输入 R和 S确定转换后的状态 。
3,逻辑功能时钟控制 R-S触发器的功能表,次态方程和约束条件与由或非门构成的 R-S触发器相同 。
在时钟控制触发器中,时钟信号 C是一种固定的时间基准,通常不作为输入信号列入表中 。 对触发器功能进行描述时,均只考虑时钟作用 (C=1)时的情况 。
第三章 集成门电路与触发器二,D触发器对时钟控制 R-S触发器的控制电路稍加修改,使之变成如下图 (a)所示的形式,这样便形成了只有一个输入端的 D触发器 。 其逻辑符号如图 (b)所示 。
修改后,控制电路在时钟脉冲作用期间 (C=1时 )，
将输入信号 D转换成一对互补信号送至基本 R-S触发器的两个输入端,使基本 R-S
触发器的两个输入信号只可能是 01或者 10两种组合,从而消除了状态不确定现象,
解决了对输入的约束问题 。
R S
第三章 集成门电路与触发器工作原理如下：
当无时钟脉冲作用（即 C=0）时，控制电路被封锁，无论 D为何值，与非门 G3,G4输出均为 1，
当时钟脉冲作用 （ 即 C=1 ） 时,若 D=0,则门
G4输出为 1,门 G3输出为 0,触发器状态被置 0；若
D=1,则门 G4输出为 0,门 G3输出为 1,触发器状态被置 1。
在时钟作用时,D触发器状态的变化仅取决于输入信号 D,而与现态无关 。 其次态方程为
Q(n+1) = D
D触发器的逻辑功能如右表所示 。
D Qn+1
0
1
0
1
D 触发器功能表第三章 集成门电路与触发器三,J-K 触发器在时钟控制 R-S触发器中增加两条反馈线,将触发器的输出 和 交叉反馈到两个控制门的输入端,并把原来的输入端 S改成 J,R改成 K,即可改进成 J-K触发器 。
J-K触发器的逻辑图和逻辑符号如下图所示 。
该触发器利用触发器两个输出端信号始终互补的特点,有效地解决了时钟控制
R-S触发器在时钟脉冲作用期间两个输入同时为 1将导致触发器状态不确定的问题 。
第三章 集成门电路与触发器
① J=0,K=0,触发器状态不变 。
② J=0,K=1,若原来处于 0状态,触发器保持 0
状态不变；若原来处于 1状态,触发器状态置成 0。 即 JK =01时,触发器次态一定为 0
状态 。
③ J=1,K=0,若原来处于 0状态,触发器状态置成 1；若原来处于 1状态,触发器保持 1态不变 。 即 JK =10时,触发器次态一定为 1状态 。
(1) 无时钟脉冲 (C=0)时,触发器保持原来状态不变 。
(2) 时钟脉冲作用 (C=1)时,与 J,K相关 。
J-K触发器的工作原理如下：
④ J=1,K=1,若原来处于 0状态，触发器置成 1 状态；若原来处于 1
状态，触发器置成 0状态。 即 JK =11时，触发器的次态与现态相反。
第三章 集成门电路与触发器归纳起来,J-K触发器的功能表如下表所示。
J-K触发器功能表
J K Qn+1 功能说明
0 0
0 1
1 0
1 1
Q
0
1
Q
不变置 0
置 1
翻转次态方程为上述 J-K触发器结构简单,且具有较强的逻辑功能,但依然存在,空翻,现象 。 为了进一步解决,空翻,问题,
实际中广泛采用 主从 J-K触发器 。
第三章 集成门电路与触发器四,T 触发器
T触发器又称为计数触发器 。 如果把 J-K触发器的两个输入端 J和 K连接起来,并把连接在一起的输入端用符号 T
表示,就构成了 T触发器 。 相应的逻辑图和逻辑符号分别如图 (a)和图 (b)所示 。
第三章 集成门电路与触发器
T
1
0
Qn+1
Q
Q
功能说明不 变翻 转
T触发器功能表
T触发器的逻辑功能可直接由 J-K触发器的次态方程导出 。 J-K触发器的次态方程为将该方程中的 J和 K均用 T代替后，即可得到 T触发器的根据次态方程,可列出 T触发器的功能表如下表所示 。
功能：
当 T=0时，触发器状态保持不变；
当 T=1时，在时钟脉冲作用下状态翻转，相当于一位二进制计数器 。
第三章 集成门电路与触发器因为在时钟脉冲作用期间，输入信号直接控制着触发器状态的变化。即当时钟 C为 1时，输入信号 R,S发生变化，触发器状态会跟着变化，从而使得一个时钟脉冲作用期间引起多次翻转。
上述由四个逻辑门构成的触发器存在空翻问题,所谓
,空翻,是指在同一个时钟脉冲作用期间触发器状态发生两次或两次以上变化的现象 。
引起空翻的原因是什么？
第三章 集成门电路与触发器为了克服“空翻”现象，实际数字电路中使用的集成 T触发器通常采用主从式结构或者维持阻塞结构。
它们除了在性能方面的改进外，逻辑功能与上述触发器完全相同。
第三章 集成门电路与触发器上面介绍了四种不同类型的时钟控制触发器，这些触发器之间可以进行逻辑功能的转换。
一般来说，在原触发器的输入端加上一定的转换逻辑电路，就可以构成具有新的逻辑功能的触发器。有关转换方法可参见教材中有关部分。
随着微电子技术的发展,人们把实现各种逻辑功能的元器件及其连线都集中制造在同一块半导体材料小片上,并封装在一个壳体中,通过引线与外界联系,即构成所谓的 集成电路块,通常又称为 集成电路芯片 。
采用集成电路进行数字系统设计的 优点：
可靠性高,可维性好,功耗低,成本低等优点,可以大大简化设计和调试过程 。
第三章 集成门电路与触发器本章知识要点,
● 半导体器件的开关特性；
● 逻辑门电路的功能、外部特性及使用方法；
● 常用触发器的功能、触发方式与外部工作特性。
第三章 集成门电路与触发器
3.1 数字集成电路的分 类数字集成电路通常按照所用半导体器件的不同或者根据集成规模的大小进行分类 。
一、根据所采用的半导体器件进行分类根据所采用的半导体器件，数字集成电路可以分为 两大类。
1.双极型集成电路,采用双极型半导体器件作为元件。主要特点是 速度快、负载能力强，但功耗较大,集成度较低。
2.单极型集成电路 (又称为 MOS集成电路 ):采用金属 -氧化物半导体场效应管 (Metel Oxide Semiconductor Field Effect
Transister)作为元件。主要特点是 结构简单、制造方便、集成度高、功耗低，但速度较慢。
第三章 集成门电路与触发器双极型集成电路又可进一步可分为：
TTL(Transistor Transistor Logic)电路；
ECL(Emitter Coupled Logic)电路；
I2L(Integrated Injection Logic)电路。
┊
TTL电路的“性能价格比”最佳，应用最广泛。
MOS集成电路又可进一步分为：
PMOS( P-channel Metel Oxide Semiconductor)；
NMOS(N-channel Metel Oxide Semiconductor)；
CMOS(Complement Metal Oxide Semiconductor)。
┊
CMOS电路应用较普遍,因为它不但适用于通用逻电路的设计,而且综合性能最好 。
第三章 集成门电路与触发器二、根据集成电路规模的大小进行分类通常根据一片集成电路芯片上包含的逻辑门个数或元件个数,分为 SSI,MSI,LSI,VLSI。
1,SSI (Small Scale Integration ) 小规模集成电路,
逻辑门数小于 10 门 (或元件数小于 100个 )；
2,MSI (Medium Scale Integration ) 中规模集成电路,
逻辑门数为 10 门～ 99 门 (或元件数 100个～ 999个 )；
3,LSI (Large Scale Integration ) 大规模集成电路,
逻辑门数为 100 门～ 9999 门 (或元件数 1000个～ 99999个 )；
4,VLSI (Very Large Scale Integration) 超大规模集成电路,
逻辑门数大于 10000 门 (或元件数大于 100000个 )。
第三章 集成门电路与触发器
3,2 半导体器件的开关特性数字电路中的晶体二极管,三极管和 MOS管等器件一般是以开关方式运用的,其工作状态相当于相当于开关的,接通,
与,断开,。
数子系统中的半导体器件运用在开关频率十分高的电路中
(通常开关状态变化的速度可高达每秒百万次数量级甚至千万次数量级 ),研究这些器件的开关特性时,不仅要研究它们的 静止特性,而且还要分析它们的 动态特性 。
静态特性是指二极管在导通和截止两种稳定状态下的特性。
3.2.1 晶体二极管的开关特性一、静态特性第三章 集成门电路与触发器典型二极管的静态特性曲线
(又称伏安特性曲线 ),
1,正向特性门槛电压 ( VTH ),使二极管开始导通的正向电压,又称为阈值电压 (一般锗管约 0.1V,硅管约 0.5V)。
★ 正向电压 VD ≤ VTH,管子截止，电阻很大、正向电流 IF 接近于 0,二极管类似于开关的断开状态 ；
★ 正向电压 VD = VTH,管子开始导通，正向电流 IF 开始上升；
★ 正向电压 VD ＞ VTH (一般锗管为 0.3V，硅管为 0.7V),管子充分导通,电阻很小，正向电流 IF 急剧增加，二极管类似于开关的接通状态。使二极管充分导通的电压为导通电压，用 VF表示。
第三章 集成门电路与触发器
2,反向特性二极管在反向电压 VR 作用下，处于截止状态，反向电阻很大，反向电流 IR 很小（将其称为反向饱和电流，用 IS 表示，通常可忽略不计 ）,二极管的状态类似于开关断开。 而且反向电压在一定范围内变化基本不引起反向电流的变化。
注意事项：
● 正向导通时可能因电流过大而导致二极管烧坏 。 组成实际电路时通常要串接一只电阻 R,以限制二极管的正向电流；
● 反向电压超过某个极限值时,将使反向电流 IR突然猛增,致使二极管被击穿 （ 通常将该反向电压极限值称为 反向击穿电压 VBR）,一般不允许反向电压超过此值 。
第三章 集成门电路与触发器二极管组成的开关电路图如图（ a）所示。二极管导通状态下的等效电路如图 (b)所示，截止状态下的等效电路如图
(c)所示，图中忽略了二极管的正向压降。
二极管开关电路及其等效电路
D
U
0 R R
断开
R
关闭
(a) (b) (c)
由于二极管的单向导电性，所以在数字电路中经常把它当作开关使用。
第三章 集成门电路与触发器二,动态特性二极管的动态特性是指二极管在导通与截止两种状态转换过程中的特性，它表现在完成两种状态之间的转换需要一定的时间。为此，引入了反向恢复时间和开通时间的概念。
1,反向恢复时间反向恢复时间,二极管从正向导通到反向截止所需要的时间称为反向恢复时间。
反向恢复时间 tre=存储时间 ts+渡越时间 tt
第三章 集成门电路与触发器
2,开通时间开通时间,二极管从反向截止到正向导通的时间称为开通时间 。
二极管的开通时间很短，对开关速度影响很小，相对反向恢复时间而言几乎可以忽略不计。
第三章 集成门电路与触发器
3.2.2 晶体三极管的开关特性晶体三极管由集电结和发射结两个 PN结构成 。 根据两个 PN结的偏置极性,三极管有 截止,放大,饱和 3种工作状态 。
一、静态特性第三章 集成门电路与触发器晶体三极管在截止与饱和这两种稳态下的特性称为三极管的静态开关特性 。
在数字逻辑电路中,三极管相当于一个由基极信号控制的无触点开关,其作用对应于触点开关的,闭合,与,断开,。
电路在三极管 截止 与 饱和 状态下的等效电路如下,
第三章 集成门电路与触发器晶体三极管在饱和与截止两种状态转换过程中具有的特性称为三极管的动态特性 。
三极管的开关过程和二极管一样,管子内部也存在着电荷的建立与消失过程 。 因此,两种状态的转换也需要一定的时间才能完成 。
二、动态特性第三章 集成门电路与触发器
1,开通时间 （ ton ）
开通时间,三极管从截止状态到饱和状态所需要的时间。
时间 ton =延迟时间 td +上升时间 tr
2,关闭时间 （ toff ）
关闭时间,三极管从饱和状态到截止状态所需要的时间 。
关闭时间 toff =存储时间 ts +下降时间 tf
开通时间 ton和关闭时间 toff是影响电路工作速度的主要因素。
第三章 集成门电路与触发器
3.2.3 MOS管的开关特性一、静态特性
MOS管作为开关元件，同样是工作在截止或导通两种状态。 MOS管是电压控制元件，主要由栅源电压 vGS决定其工作状态。
当 VGS＜开启电压 VTN时,MOS管工作在截止区,输出电压 vDS ≈VDD,MOS管处于,断开,状态 ;
当 VDS≥VGS－ VTN时,MOS管工作在导通区,输出电压
vDS≈ 0V,MOS管处于,接通,状态 。
第三章 集成门电路与触发器二、动态特性
MOS管本身导通和截止时电荷积累和消散的时间很小。
动态特性主要取决于电路中杂散电容充、放电所需的时间。
第三章 集成门电路与触发器为了提高 MOS器件的工作速度,引入了 CMOS电路 。
在 CMOS电路中,由于充电电路和放电电路都是低阻电路,因此,其充,放电过程都比较快,从而使 CMOS电路有较高的开关速度 。
第三章 集成门电路与触发器
3.3 逻 辑 门 电 路实现基本逻辑运算和常用复合逻辑运算的逻辑器件统称为逻辑门电路,它们是组成数字系统的基本单元电路 。
学习时应重点掌握集成逻辑门电路的功能和外部特性,
以及器件的使用方法 。 对其内部结构和工作原理只要求作一般了解 。
第三章 集成门电路与触发器
3.3.1 TTL 集成逻辑门电路
TTL(Transistor Transistor Logic)电路是晶体管 -晶体管逻辑电路的简称。
TTL电路的功耗大、线路较复杂，使其集成度受到一定的限制，故广泛应用于中小规模逻辑电路中。
下面，对几种常见 TTL门电路进行介绍，重点讨论 TTL
与非门。
第三章 集成门电路与触发器一、典型 TTL与非门该电路可按 图中虚线划分为 三部分：
输入级 —— 由多发射极晶体管 T1和电阻 R1组成；
中间级 —— 由晶体管 T2和电阻 R2,R3组成；
输出级 —— 由晶体管 T3,T4,D4和电阻 R4,R5组成。
1,电路结构及工作原理
(1) 电路结构典型 TTL与非门电路图及相应逻辑符号如右图所示。
第三章 集成门电路与触发器
(2) 工作原理
※ 输入端全部接高电平 (3.6V),电源 Vcc通过 R1和 T1的集电结向 T2提供足够的基极电流,使 T2饱和导通 。 T2的发射极电流在 R3上产生的压降又使 T4 饱和导通,输出为低电平 (≈ 0.3V)。
实现了,输入全高,输出为低,的逻辑关系 。
※ 当有输入端接低电平 (0.3V)时,输入端接低电平的发射结导通，使 T1的基极电位 Vb1=0.3V+0.7V=1V。该电压作用于 T1的集电结和 T2、
T4的发射结上，不可能使 T2和 T4导通。 由于 T2截止，电源 VCC通过 R2驱动
T3和 D4管，使之工作在导通状态，电路输出为高电平 (≈3.6V)。
实现了,输入有低，输出为高” 的逻辑功能。
第三章 集成门电路与触发器归纳,当输入 A,B,C均为高电平时,输出为低电平
(≈ 0V)；当 A,B,C中至少有一个为低电平时,输出为高电平 (≈ 3.6V)。 输出与输入之间为,与非,逻辑,即
A B CF?
第三章 集成门电路与触发器
2,主要外部特性参数
TTL与非门的主要外部特性参数有输出逻辑电平,开门电平,关门电平,扇入系数,扇出系数,平均传输时延和空载功耗等 。
(2) 输出低电平 VOL,输出低电平 VoL是指输入全为高电平时的输出电平 。 VOL的典型值是 0.3V。
(1) 输出高电平 VOH,指至少有一个输入端接低电平时的输出电平 。 VOH的典型值是 3.6V。
(3) 开门电平 VO N,指在额定负载下，使输出电平达到标准低电平
VSL的输入电平，它表示使与非门开通的最小输入电平。 VON的产品规范值为 VON≤1.8V 。
第三章 集成门电路与触发器
(4) 关门电平 VOFF,指输出空载时,使输出电平达到标准高电平 VSH的输入电平,它表示使与非门关断所允许的最大输入电平 。 VOFF 的产品规范值 VOFF≥ 0.8V。
(5) 扇入系数 Ni,指与非门允许的输入端数目。
(6) 扇出系数 No,指与非门输出端连接同类门的最多个数。
(7) 输入短路电流 IiS,指当与非门的某一个输入端接地而其余输入端 悬空时,流过接地输入端的电流 。
(8) 高电平输入电流 IiH,指某一输入端接高电平,而其他输入端接地时,流入高电平输入端的电流,又称为输入漏电流 。
第三章 集成门电路与触发器
(9) 平均传输延迟时间 tpd,指一个矩形波信号从与非门输入端传到与非门输出端 (反相输出 )所延迟的时间。通常将从输入波上沿中点到输出波下沿中点的时间延迟称为导通延迟时间 tpdL；从输入波下沿中点到输出波上沿中点的时间延迟称为截止延迟时间 tpdH。
平均延迟时间为,tpd = ( tpdL+ tpdH )/2
(10) 空载功耗 P,指与非门空载时电源总电流 ICC和电源电压 VCC的乘积 。
输出为低电平时的功耗称为空载导通功耗 PON,输出为高电平时的功耗称为空载截止功耗 POFF 。
平均功耗为,P =(PON + POFF)/2
第三章 集成门电路与触发器
3,TTL与非门集成电路芯片
TTL与非门集成电路芯片种类很多,常用的 TTL与非门集成电路芯片有 7400和 7420等 。
7400的引脚分配图如图 (a)所示； 7420的引脚分配图如图 (b)所示 。
第三章 集成门电路与触发器二、其他功能的 TTL门电路集成 TTL门电路还有 与门、或门、非门、或非门、与或非门、异或门 等不同功能的产品。此外，还有两种特殊门电路 —— 集电极开路门 (OC
门 )和三 态门 (TS门 )。
(1) 非门
1,几种常用的 TTL门电路第三章 集成门电路与触发器
(2) 或非门常用的 TTL或非门集成电路芯片有 2输入 4或非门 7402等。
7402的引脚分配图如下图所示。
第三章 集成门电路与触发器
(3) 与或非门常用的 TTL与或非门集成电路芯片 7451的引脚排列图如下图所示。
第三章 集成门电路与触发器
2,两种特殊的门电路
(1) 集电极开路门 (OC门 )
集电极开路门 (Open Collector Gate）是一种输出端可以直接相互连接的特殊逻辑门，简称 OC门。
图给出了一个集电极开路与非门的电路结构图和逻辑符号。
第三章 集成门电路与触发器注意 ！ 集电极开路与非门只有在外接负载电阻 RL和电源 U’CC后才能正常工作 。
集电极开路与非门在计算机中应用很广泛,可以用它实现 "线与 "逻辑,电平转换以及直接驱动发光二极管,干簧继电器等 。
第三章 集成门电路与触发器
(2) 三态输出门 (TS门 )
三态输出门有三种输出状态,输出高电平、输出低电平和高阻状态，前两种状态为工作状态，后一种状态为禁止状态 。 简称三态门 (Three state Gate),TS门等。
注意 ! 三态门不是指具有三种逻辑值。
如何使电路处在工作状态和禁止状态？
通过外加控制信号！
第三章 集成门电路与触发器例如：
该电路逻辑功能如下：
EN=0,二极管 D反偏,此时电路功能与一般与非门无区别,输出 ；
EN=1,一方面因为 T1有一个输入端为低,使 T2,T5截止 。 另一方面由于二极管导通,迫使 T3的基极电位变低,致使 T3,T4也截止 。 输出 F便被悬空,即处于高阻状态 。
第三章 集成门电路与触发器三态门常用于总线传输控制 。 如下图所示,用两种不同控制输入的三态门可构成的双向总线 。
图中：
EN=1时,G1工作,G2处于高阻状态,数据 D1被取反后送至总线；
EN=0时,G2工作,G1处于高阻状态,总线上的数据被取反后送到数据端 D2。
实现了数据的分时双向传送 。
第三章 集成门电路与触发器
3.3.2 CMOS集成逻辑门电路
MOS型集成门电路的主要 优点：制造工艺简单、集成度高、功耗小、抗干扰能力强等；主要缺点：速度相对 TTL电路较低 。
MOS门电路有三种类型：
使用 P沟道管的 PMOS电路；
使用 N沟道管的 NMOS电路；
同时使用 PMOS管和 NMOS管的 CMOS电路 。
相比之下,CMOS电路性能更优,是当前应用较普遍的逻辑电路之一 。 下面,仅讨论 CMOS集成逻辑门 。
第三章 集成门电路与触发器一,CMOS反相器由一个 N沟道增强型 MOS管 TN和一个 P沟道增强型 MOS管 TP组成的 CMOS
反相器如下图所示。
电路正常工作条件,VDD大于 TN管开启电压 VTN和 TP管开启电压 VTP的绝对值之和，即 VDD＞ VTN +|VTP|。
工作原理,vi=0V,TN截止,TP导通,vO≈VDD为高电平； vi = VDD,TN导通,TP截止,vO≈0V。实现了 "非 " 的逻辑功能。
第三章 集成门电路与触发器二,CMOS与非门由两个串联的 NMOS管和两个并联的 PMOS管构成的两输入端的 CMOS与非门电路如下图所示。
工作原理：
当输入 A,B均为高电平时,TN1和
TN2导通,TP1和 TP2截止,输出端 F为低电平；
当输入 A,B中至少有一个为低电平时,对应的 TN1 和 TN2中至少有一个截止,
TP1和 TP2中至少有一个导通,输出 F为高电平 。
该电路实现了,与非,逻辑功能 。
第三章 集成门电路与触发器三,CMOS或非门由两个并联的 NMOS管和两个串联的 PMOS管构成一个两个输入端的 CMOS或非门电路如下图所示 。 每个输入端连接到一个 NMOS管和一个 PMOS管的栅极 。
工作原理：
当输入 A,B均为低电平时,TN1和
TN2截止,TP1和 TP2导通,输出 F为高电平；
当输入端 A,B 中至少有一个为高电平时,则对应的 TN1,TN2中便至少有一个导通,TP1,TP2中便至少有一个截止,使输出 F为低电平 。
该电路实现了,或非,逻辑功能 。
第三章 集成门电路与触发器四,CMOS三态门
EN=1,T’N和 T’P同时截止,输出 F
呈高阻状态；
EN =0,T’N和 T’P同时导通,非门正常工作,实现 的功能 。
第三章 集成门电路与触发器
3.3.3 正逻辑和负逻辑前面讨论各种逻辑门电路的逻辑功能时,约定用高电平表示逻辑 1,低电平表示逻辑 0。 事实上,既可以规定用高电平表示逻辑 1,低电平表示逻辑 0,也可以规定用高电平表示逻辑 0,低电平表示逻辑 1。 这就引出了正逻辑和负逻辑的概念 。
正逻辑,用高电平表示逻辑 1,低电平表示逻辑 0。
负逻辑,用高电平表示逻辑 0,低电平表示逻辑 1。
第三章 集成门电路与触发器前面讨论各种逻辑门电路时，都是按照正逻辑规定来定义其逻辑功能的。
在本课程中,若无特殊说明,约定按正逻辑讨论问题,所有门电路的符号均按正逻辑表示 。
第三章 集成门电路与触发器
3.4 触 发 器在数字系统中,为了构造实现各种功能的逻辑电路,除了需要实现逻辑运算的逻辑门之外,还需要有能够保存信息的逻辑器件 。 触发器是一种具有记忆功能的电子器件 。
触发器能用来存储一位二进制信息。集成触发器的种类很多，分类方法也各不相同，但就其结构而言,都是由逻辑门加上适当的反馈线耦合而成。
第三章 集成门电路与触发器触发器的特点：
☆ 有两个互补的输出端 Q 和
☆ 在一定输入信号作用下，触发器可以从一个稳定状态转移到另一个稳定状态。
☆ 有两个稳定状态 。 通常将 Q = 1和 = 0 称为,1”状态,而把 Q = 0和 = 1称为,0” 状态 。 当输入信号不发生变化时,触发器状态稳定不变 。
第三章 集成门电路与触发器现态,输入信号作用前的状态，记作 Qn 和,一般简记为 Q和 ；
次态,输入信号作用后的状态，记作 Qn+1和 。
显然，次态是现态和输入的函数。
现态与次态的概念：
第三章 集成门电路与触发器
3.4.1 基本 R-S触发器基本 R-S触发器是直接复位置位触发器的简称，由于它是构成各种功能触发器的基本部件，故称为基本 R-S触发器。
一,用与非门构成的基本 R-S触发器
1.组成,由两个与非门交叉耦合构成,其逻辑图和逻辑符号分别如下图 (a)和 (b)所示 。 图中,R称为置 0端或者复位端，
S称为置 1端或置位端； 逻辑符号输入端加的小圆圈表示低电平或负脉冲有效。
第三章 集成门电路与触发器
2,工作原理
(1) 若 R=1,S=1，则触发器保持原来状态不变；
(2) 若 R=1,S=0,则触发器置为 1状态；
(3) 若 R=0,S=1,则触发器置为 0状态；
(4) 不允许出现 R=0,S=0。
第三章 集成门电路与触发器表中 "d"表示触发器次态不确定。该表又称为 次态真值表 。
RS Qn+1 功能说明
0 0
0 1
1 0
1 1
d
0
1
Q
不定置 0
置 1
不变基本 R-S触发器功能表
3,逻辑功能及其描述由与非门构成的 R-S触发器的逻辑功能如下表所示 。
第三章 集成门电路与触发器因为 R,S不允许同时为 0，所以输入必须满足 约束条件：
R + S = 1 (约束方程 )
若把触发器次态 Qn+1表示成现态 Q和输入 R,S的函数,则卡诺图如下：
用卡诺图化简后，可得到该触发器的 次态方程,
RQSQ n 1
第三章 集成门电路与触发器二、用或非门构成的基本 R-S触发器
1.组成,由两个或非门交叉耦合组成,其逻辑图和逻辑符号分别如图 (a)和图 (b)所示 。
该电路的输入是正脉冲或高电平有效,故逻辑符号的输入端未加小圆圈 。
第三章 集成门电路与触发器
2,逻辑功能下表给出了由或非门构成的 R-S触发器的逻辑功能。
RS Qn+1 功能说明
0 0
0 1
1 0
1 1
Q
1
0
d
不变置 1
置 0
不定基本 R-S触发器功能表基本 R-S触发器的 优点是结构简单 。 它不仅可作为记忆元件独立使用,而且由于它具有直接复位,置位功能,因而被作为各种性能完善的触发器的基本组成部分 。 但由于 R,S之间的约束关系,以及不能进行定时控制,使它的使用受到一定限制 。
次态方程和约束方程如下：
(次态方程 )
R · S = 0 (约束方程 )
第三章 集成门电路与触发器
3.4.2 几种常用的时钟控制触发器具有时钟脉冲控制的触发器称为,时钟控制触发器,或者
,定时触发器,。
时钟脉冲控制触发器的工作特点：
由时钟脉冲确定状态转换的时刻 (即何时转换？ ) ；
由输入信号确定触发器状态转换的方向 (即如何转换？ )。
下面介绍四种最常用的时钟控制触发器 。
第三章 集成门电路与触发器一,时钟控制 R-S触发器时钟控制 R-S触发器的逻辑图和逻辑符号如图 (a)、（ b）所示。
1,组成：
由四个与非门构成 。 其中,与非门 G1,G2构成基本 R-S
触发器；与非门 G3,G4组成控制电路,通常称为控制门 。
第三章 集成门电路与触发器
2,工作原理具体如下：
R=0,S=0,控制门 G3,G4的输出均为 1，
触发器状态保持不变；
R=0,S=1,控制门 G3,G4的输出分别为 1和 0,触发器状态置成 1状态；
R=1,S=0,控制门 G3,G4的输出分别为
0和 1,触发器状态置成 0状态；
R=1,S=1,控制门 G3,G4的输出均为 0，
触发器状态不确定,这是不允许的 。
● 当时钟脉冲没有到来（即 C=0）时，不管 R,S端为何值，
两个控制门的输出均为 1，触发器状态保持不变。
● 当时钟脉冲到来 （ 即 C=1） 时,输入端 R,S的值 可以通过控制门作用于上面的基本 R-S触发器 。
第三章 集成门电路与触发器注意 ！ 时钟控制 R-S触发器虽然解决了对触发器工作进行定时控制的问题,而且具有结构简单等优点,但依然存在如下两点不足：
● 输入信号依然存在约束条件,即 R,S不能同时为 1；
由分析可知,时钟控制 R-S触发器的工作过程是由时钟信号 C和输入信号 R,S共同作用的；时钟 C控制转换时间,
输入 R和 S确定转换后的状态 。
3,逻辑功能时钟控制 R-S触发器的功能表,次态方程和约束条件与由或非门构成的 R-S触发器相同 。
在时钟控制触发器中,时钟信号 C是一种固定的时间基准,通常不作为输入信号列入表中 。 对触发器功能进行描述时,均只考虑时钟作用 (C=1)时的情况 。
第三章 集成门电路与触发器二,D触发器对时钟控制 R-S触发器的控制电路稍加修改,使之变成如下图 (a)所示的形式,这样便形成了只有一个输入端的 D触发器 。 其逻辑符号如图 (b)所示 。
修改后,控制电路在时钟脉冲作用期间 (C=1时 )，
将输入信号 D转换成一对互补信号送至基本 R-S触发器的两个输入端,使基本 R-S
触发器的两个输入信号只可能是 01或者 10两种组合,从而消除了状态不确定现象,
解决了对输入的约束问题 。
R S
第三章 集成门电路与触发器工作原理如下：
当无时钟脉冲作用（即 C=0）时，控制电路被封锁，无论 D为何值，与非门 G3,G4输出均为 1，
当时钟脉冲作用 （ 即 C=1 ） 时,若 D=0,则门
G4输出为 1,门 G3输出为 0,触发器状态被置 0；若
D=1,则门 G4输出为 0,门 G3输出为 1,触发器状态被置 1。
在时钟作用时,D触发器状态的变化仅取决于输入信号 D,而与现态无关 。 其次态方程为
Q(n+1) = D
D触发器的逻辑功能如右表所示 。
D Qn+1
0
1
0
1
D 触发器功能表第三章 集成门电路与触发器三,J-K 触发器在时钟控制 R-S触发器中增加两条反馈线,将触发器的输出 和 交叉反馈到两个控制门的输入端,并把原来的输入端 S改成 J,R改成 K,即可改进成 J-K触发器 。
J-K触发器的逻辑图和逻辑符号如下图所示 。
该触发器利用触发器两个输出端信号始终互补的特点,有效地解决了时钟控制
R-S触发器在时钟脉冲作用期间两个输入同时为 1将导致触发器状态不确定的问题 。
第三章 集成门电路与触发器
① J=0,K=0,触发器状态不变 。
② J=0,K=1,若原来处于 0状态,触发器保持 0
状态不变；若原来处于 1状态,触发器状态置成 0。 即 JK =01时,触发器次态一定为 0
状态 。
③ J=1,K=0,若原来处于 0状态,触发器状态置成 1；若原来处于 1状态,触发器保持 1态不变 。 即 JK =10时,触发器次态一定为 1状态 。
(1) 无时钟脉冲 (C=0)时,触发器保持原来状态不变 。
(2) 时钟脉冲作用 (C=1)时,与 J,K相关 。
J-K触发器的工作原理如下：
④ J=1,K=1,若原来处于 0状态，触发器置成 1 状态；若原来处于 1
状态，触发器置成 0状态。 即 JK =11时，触发器的次态与现态相反。
第三章 集成门电路与触发器归纳起来,J-K触发器的功能表如下表所示。
J-K触发器功能表
J K Qn+1 功能说明
0 0
0 1
1 0
1 1
Q
0
1
Q
不变置 0
置 1
翻转次态方程为上述 J-K触发器结构简单,且具有较强的逻辑功能,但依然存在,空翻,现象 。 为了进一步解决,空翻,问题,
实际中广泛采用 主从 J-K触发器 。
第三章 集成门电路与触发器四,T 触发器
T触发器又称为计数触发器 。 如果把 J-K触发器的两个输入端 J和 K连接起来,并把连接在一起的输入端用符号 T
表示,就构成了 T触发器 。 相应的逻辑图和逻辑符号分别如图 (a)和图 (b)所示 。
第三章 集成门电路与触发器
T
1
0
Qn+1
Q
Q
功能说明不 变翻 转
T触发器功能表
T触发器的逻辑功能可直接由 J-K触发器的次态方程导出 。 J-K触发器的次态方程为将该方程中的 J和 K均用 T代替后，即可得到 T触发器的根据次态方程,可列出 T触发器的功能表如下表所示 。
功能：
当 T=0时，触发器状态保持不变；
当 T=1时，在时钟脉冲作用下状态翻转，相当于一位二进制计数器 。
第三章 集成门电路与触发器因为在时钟脉冲作用期间，输入信号直接控制着触发器状态的变化。即当时钟 C为 1时，输入信号 R,S发生变化，触发器状态会跟着变化，从而使得一个时钟脉冲作用期间引起多次翻转。
上述由四个逻辑门构成的触发器存在空翻问题,所谓
,空翻,是指在同一个时钟脉冲作用期间触发器状态发生两次或两次以上变化的现象 。
引起空翻的原因是什么？
第三章 集成门电路与触发器为了克服“空翻”现象，实际数字电路中使用的集成 T触发器通常采用主从式结构或者维持阻塞结构。
它们除了在性能方面的改进外，逻辑功能与上述触发器完全相同。
第三章 集成门电路与触发器上面介绍了四种不同类型的时钟控制触发器，这些触发器之间可以进行逻辑功能的转换。
一般来说，在原触发器的输入端加上一定的转换逻辑电路，就可以构成具有新的逻辑功能的触发器。有关转换方法可参见教材中有关部分。
